第二章 EDA设计流程.ppt

《第二章 EDA设计流程.ppt》由会员上传分享，免费在线阅读，更多相关内容在行业资料-天天文库。

1、EDA技术实用教程第2章EDA设计流程及其工具2.1EDA设计流程图2-1应用于FPGA/CPLD的EDA开发流程1.设计准备在系统设计之前，首先要进行方案论证、系统设计和器件选择等准备工作。设计人员根据任务要求，如系统的功能和复杂度，对工作速度和器件本身的资源、成本及连线的可布性等方面进行权衡，选择合适的设计方案和合适的器件类型。一般采用自上而下的设计方法，也可采用传统的自下而上的设计方法。2.设计输入设计人员将所设计的系统或电路以开发软件要求的某种形式表示出来，并送入计算机的过程称为设计输入。设计输入通常有以下几种形式。1)原理图输入方式原理图输入方式是一种最直接的设计

2、描述方式，要设计什么，就从软件系统提供的元件库中调出来，画出原理图，这样比较符合人们的习惯。这种方式要求设计人员有丰富的电路知识及对PLD的结构比较熟悉。其主要优点是容易实现仿真，便于信号的观察和电路的调整；缺点是效率低，特别是产品有所改动，需要选用另外一个公司的PLD器件时，就需要重新输入原理图，而采用硬件描述语言输入方式就不存在这个问题。2)硬件描述语言输入方式硬件描述语言是用文本方式描述设计，它分为普通硬件描述语言和行为描述语言。普通硬件描述语言有ABEL、CUR和LFM等，它们支持逻辑方程、真值表、状态机等逻辑表达方式，主要用于简单PLD的设计输入。行为描述语言是目

3、前常用的高层硬件描述语言，主要有VHDL和VerilogHDL两个IEEE标准。其突出优点有：语言与工艺的无关性，可以使设计人员在系统设计、逻辑验证阶段便确立方案的可行性；语言的公开可利用性，便于实现大规模系统的设计；具有很强的逻辑描述和仿真功能，而且输入效率高，在不同的设计输入库之间的转换非常方便，用不着对底层的电路和PLD结构的熟悉。3)波形输入方式波形输入方式主要是用来建立和编辑波形设计文件，以及输入仿真向量和功能测试向量。波形设计输入适用于时序逻辑和有重复性的逻辑函数。系统软件可以根据用户定义的输入／输出波形自动生成逻辑关系。波形编辑功能还允许设计人员对波形进行拷贝

4、、剪切、粘贴、重复与伸展，从而可以用内部节点、触发器和状态机建立设计文件，并将波形进行组合，显示各种进制的状态值，也可以将一组波形重叠到另一组波形上，对两组仿真结果进行比较。3.功能仿真功能仿真也叫前仿真。用户所设计的电路必须在编译之前进行逻辑功能验证，此时的仿真没有延时信息，对于初步的功能检测非常方便。仿真前，要先利用波形编辑器和硬件描述语言等建立波形文件和测试向量（即将所关心的输入信号组合成序列），仿真结果将会生成报告文件和输出信号波形，从中便可以观察到各个节点的信号变化。如果发现错误，则返回设计输入中修改逻辑设计。4.设计处理设计处理是器件设计中的核心环节。在设计处理

5、过程中，编译软件将对设计输入文件进行逻辑化简、综合优化和适配，最后产生编程用的编程文件。1)语法检查和设计规则检查设计输入完成后，首先进行语法检查，如原理图中有无漏连信号线，信号有无双重来源，文本输入文件中关键字有无输错等各种语法错误，并及时列出错误信息报告供设计人员修改，然后进行设计规则检验，检查总的设计有无超出器件资源或规定的限制，并将编译报告列出，指明违反规则情况以供设计人员纠正。2)逻辑优化和综合化简所有的逻辑方程或用户自建的宏，使设计所占用的资源最少。综合的目的是将多个模块化设计文件合并为一个网表文件，并使层次设计平面化。VHDL综合器运行流程①、约束条件：在逻辑

6、综合过程中，为优化输出和工艺映射的需要，一定要有相应的约束条件以实现对设计实体的控制。如：面积、速度、功耗、可测性。②、工艺库：工艺库将提供综合工具所需要的全部半导体工艺信息。即工艺库不仅含有ASIC单元的逻辑功能、单元面积、输入到输出的定时关系、输出的扇出限制和对单元所需的定时检查。③、逻辑综合3步曲：逻辑综合工具将RTL级描述转换为门级描述一般有3步：1）.将RTL描述（VHDL程序）转换为未优化的门级布尔描述（布尔逻辑方程的形式）这一步称为“展平”。2）.执行优化算法，化简布尔方程，这一步称为“优化”。3）.按半导体工艺要求，采用相应的工艺库，把优化的布尔描述映射成实

7、际的逻辑电路（逻辑实现）④.门级映射网表：过程：取出优化后的布尔描述，并利用工艺库中得到的逻辑和定时上的信息去做网表，网表是对用户所描述的面积和速度指标的一种体现形式。工艺库中存有大量的网表，它们的功能相同，但可以在速度和面积之间权衡。3）适配适配器也称结构综合器，它的功能是将由综合器产生的网表文件配置于指定的目标器件中，使之产生最终的下载文件，如JEDEC、Jam格式的文件。适配所选定的目标器件(FPGA/CPLD芯片)必须属于原综合器指定的目标器件系列。逻辑综合通过后必须利用适配器将综合后网表文件针对某一具体的